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Sous-système esclave PROFIBUS DP pour FPGA Altera-Intel

Cœur IP esclave PROFIBUS DP et processeur de communication pour l’intégration de PROFIBUS sur un FPGA Altera-Intel

  • Simplification de la connectivité PROFIBUS DP pour les appareils de terrain avec FPGA Altera-Intel
  • Le noyau IP optimisé PROFIBUS DP et le logiciel préinstallé gèrent l'ensemble du protocole
  • PROFIBUS DP et d'autres réseaux industriels sont pris en charge par la même API
  • Fonctionnement rapide et fiable grâce au support matériel/logique et à la redondance de ligne en option

Vue d'ensemble

Sous-système PROFIBUS DP facile à intégrer pour les FGPA

  • L'ensemble du protocole est géré par un logiciel préinstallé, aucun portage n'est nécessaire
  • Exemple de projet pour une rapide prise en main
  • Adaptation aux exigences de l'application grâce à des options de configuration étendues
  • Large choix de familles et de tailles de FPGA prises en charge

Coût total de possession faible

  • Pas de dépendance à l'égard d'ASIC spéciaux
  • Mise en œuvre sans risque grâce aux services de conseil, d'intégration et de pré-certification de Softing
  • Reconfiguration et extension possibles même après la production
  • Ajout simple de protocoles supplémentaires

Pré-certifié conforme aux normes les plus récentes

  • Conforme aux spécifications PROFIBUS actuelles
  • Testé avec l'outil de test de conformité actuel « Testeur PROFIBUS DP »

Fonctionnement rapide et fiable

  • Le cœur IP PROFIBUS DP prend en charge des débits en bauds jusqu'à 12 Mbits/s, offrant une reconnaissance automatique et rapide du débit en bauds.
  • Le logiciel d'application de l'appareil est séparé du logiciel de protocole
  • Prise en charge de la redondance des esclaves et de la redondance des lignes en option
  • Temps de cycle jusqu'à 100 µs

Caractéristiques techniques

Sous-système esclave PROFIBUS DP pour FPGA Altera-Intel

Configuration Cœur IP

  • Cœur IP PROFIBUS DP esclave
  • Cœur IP de l'unité centrale de communication pour le traitement du protocole PROFIBUS DP
  • Interface DPRAM vers le processeur d’applications (interne au FPGA ou externe)
Horloges PROFIBUS 16 MHz, 84 MHz
Familles FPGA compatibles Cyclone III, Cyclone IV, Cyclone V, Cyclone V SoC, Cyclone 10 LP, MAX 10
Fonctionnalité
  • PROFIBUS DP esclave
  • PROFIBUS DP, PROFIBUS DP-V1
  • Services cycliques
  • Synchronisation / gel
  • Données d'entrée et de sortie : jusqu'à 244 octets chacun
  • Données de configuration, de paramétrage et de diagnostic : jusqu'à 244 octets chacun
  • Lecture/écriture acyclique (maître classe 1 et classe 2)
  • Jusqu'à 3 connexions maître classe 2 simultanées
  • Reconnaissance automatique du débit en bauds
  • Services d'identification et de maintenance (IM0)
  • Esclave modulaire avec jusqu'à 64 modules
  • Prise en charge de la configuration dynamique des E/S par l'application esclave
  • Alarmes de diagnostic et alarmes de déconnexion/reconnexion
  • Prise en charge de la commande de commutation de la redondance
  • Redondance de ligne en option
Temps de cycle jusqu’à 100 μs (intervalle esclave minimum)
Interface de programmation (API) Interface d'application d'appareil simple (SDAI)

Données de la commande

Contenu de la livraison  
IP / Logic
  • Sous-système PROFIBUS DP esclave complet
  • Cœurs IP supplémentaires
  • Exemple de conception d’application FPGA
Logiciel
  • Logiciel de protocole prêt à l'emploi (exécutable) pour le sous-système PROFIBUS DP esclave
  • Bibliothèque API pour le processeur d'application (y compris le code source)
  • Exemple de logiciel d'application (y compris le code source)
Documentation Téléchargement : Guide d'application du sous-système PROFIBUS DP et informations complémentaires
Numéros de commande  
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