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Subsistema esclavo PROFIBUS DP para FPGA de Altera-Intel

Núcleo IP esclavo PROFIBUS DP y procesador de comunicación para la integración de PROFIBUS en FPGA de Altera-Intel

  • Simplifica la conectividad PROFIBUS DP para dispositivos de campo con FPGA de Altera-Intel
  • El núcleo IP PROFIBUS DP optimizado y el software preinstalado gestionan todo el protocolo
  • PROFIBUS DP y otras redes industriales son compatibles con la misma API
  • Funcionamiento rápido y estable gracias al soporte de hardware/lógica y a la redundancia de línea opcional
Subsistema esclavo PROFIBUS DP para FPGA de Altera-Intel

Descripción general

Subsistema PROFIBUS DP fácil de integrar para FPGAs

  • Todo el protocolo se gestiona mediante software preinstalado, sin necesidad de migración
  • Proyecto de ejemplo para una rápida experiencia práctica
  • Adaptación a los requisitos de la aplicación gracias a numerosas opciones de configuración
  • Gran variedad de familias y tamaños de FPGA compatibles

Coste total de propiedad reducido

  • Sin dependencia de ASICs especiales
  • Implantación sin riesgos gracias a los servicios de consultoría, integración y precertificación de Softing
  • Posibilidad de reconfiguración y ampliación incluso después de la producción
  • Adición fácil de otros protocolos

Precertificado según los estándares más recientes

  • Cumple las especificaciones PROFIBUS actuales
  • Probado con la herramienta de test de conformidad actual «PROFIBUS DP Tester»

Funcionamiento rápido y estable

  • El núcleo IP PROFIBUS DP admite velocidades de transmisión de hasta 12 Mbit/s y ofrece un reconocimiento rápido y automático de la velocidad de transmisión.
  • El software de aplicación del dispositivo está separado del software de protocolo
  • Compatibilidad con redundancia de esclavos y redundancia de línea opcional
  • Tiempos de ciclo de hasta 100 μs

Datos técnicos

Subsistema esclavo PROFIBUS DP para FPGA de Altera-Intel

Configuración del núcleo IP
  • Núcleo IP de esclavo PROFIBUS DP
  • Núcleo IP de CPU de comunicación para procesar el protocolo PROFIBUS DP
  • Interfaz DPRAM con el procesador de aplicación (interno o externo de FPGA)
Relojes PROFIBUS 16 MHz, 84 MHz
Familias de FPGA compatibles Cyclone III, Cyclone IV, Cyclone V, Cyclone V SoC, Cyclone 10 LP, MAX 10
Funcionalidad
  • Esclavo PROFIBUS DP
  • PROFIBUS DP, PROFIBUS DP-V1
  • Servicios cíclicos
  • Sincronizar / Congelar
  • Datos de entrada/salida: hasta 244 Bytes cada uno
  • Datos de configuración / parámetros / diagnóstico: hasta 244 Bytes cada uno
  • Lectura/escritura acíclica (Master Clase 1 y Clase 2)
  • Hasta 3 conexiones Master Clase 2 simultáneas
  • Reconocimiento automático de la velocidad de transmisión
  • Servicios de identificación y mantenimiento (IM0)
  • Esclavo modular con hasta 64 módulos
  • Soporte de configuración dinámica de E/S por la aplicación Esclavo
  • Alarmas de diagnóstico y alarmas de inserción/extracción (Pull/Plug).
  • Soporte del comando de conmutación por redundancia
  • Redundancia de línea opcional
Tiempo de ciclo hasta 100 μs (intervalo esclavo mínimo)
Interfaz de programación de aplicaciones Interfaz de aplicación de dispositivo simple (SDAI)

Información del pedido

Volumen de suministro  
IP / Lógica
  • Subsistema esclavo PROFIBUS DP completo
  • Núcleos IP suplementarios
  • Ejemplo de diseño FPGA
Software
  • Software de protocolo listo para funcionar (ejecutable) para el subsistema esclavo PROFIBUS DP
  • Biblioteca de API para el procesador de aplicación (incluido el código fuente)
  • Software de aplicación de muestra (incluido el código fuente)
Documentación Descargar: Guía de implementación del subsistema PROFIBUS DP e información adicional
Números de referencia  
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Estaremos encantados de estudiar con usted sus necesidades específicas y las opciones de licencia adecuadas.
Productos y servicios adicionales  
SIA-YY-012501 Cursillo de integración para la implementación de PROFIBUS DP
SIA-YY-012503 Soporte para la integración por correo electrónico o teléfono
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