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Subsistema adaptador EtherNet/IP para FPGA Xilinx-AMD

Núcleo IP de conmutación y procesador de comunicación para la integración de EtherNet/IP en FPGA Xilinx-AMD

  • Simplifica la conectividad EtherNet/ IP para dispositivos de campo con FPGA Xilinx-AMD
  • El núcleo IP de conmutación optimizado y el software preinstalado gestionan todo el protocolo
  • EtherNet/IP y otras redes industriales son compatibles con la misma API
  • Funcionamiento rápido y estable gracias al soporte de hardware/lógica y a las funciones de redundancia
Subsistema adaptador EtherNet/IP para FPGA Xilinx-AMD

Descripción general

Subsistema adaptador EtherNet/IP fácil de integrar para FPGAs

  • Todo el protocolo se gestiona mediante software preinstalado, sin necesidad de migración
  • Proyecto de ejemplo para una rápida experiencia práctica
  • Adaptación a los requisitos de la aplicación gracias a numerosas opciones de configuración
  • Gran variedad de familias y tamaños de FPGA compatibles

Coste total de propiedad reducido

  • Sin dependencia de ASICs especiales
  • Implantación sin riesgos gracias a los servicios de consultoría, integración y precertificación de Softing
  • Posibilidad de reconfiguración y ampliación incluso después de la producción
  • Adición fácil de otros protocolos

Precertificado según los estándares más recientes

  • Cumple las especificaciones EtherNet/IP actuales
  • Puede actuar como "black channel" (canal no confiable) para aplicaciones de seguridad
  • Soporta redundancia de medios (DLR)

Funcionamiento rápido y estable

  • Núcleo IP de conmutación industrial con reenvío anticipado (cut-through) y filtrado (cortafuegos)
  • Manejo de datos en software o hardware (DMA)
  • El software de aplicación del dispositivo está separado del software de protocolo
  • Tiempos de ciclo de hasta 100 μs

Datos técnicos

Subsistema adaptador EtherNet/IP para FPGA Xilinx-AMD

Configuración del núcleo IP
  • Núcleo IP de conmutación con 2 puertos externos y 1 ó 2 internos
  • Núcleo IP de CPU de comunicación para procesar el protocolo EtherNet/IP
  • Interfaz DPRAM con el procesador de aplicación (interno o externo de FPGA)
Reloj de conmutación 125 MHz
Familias de FPGA compatibles Zynq UltraScale+, Zynq-7000, Spartan 7 y otras FPGA de la serie 7
Funcionalidad
  • Adaptador EtherNet/IP conforme a la prueba de conformidad ODVA CT-20
  • Redundancia de medios (anillo a nivel de dispositivo; basado en anuncios y balizas)
  • Protocolo LLDP
  • Compatible con calidad de servicio (QoS)
  • Compatibilidad con Quick Connect
  • Soporte de comunicación para CIP Safety
  • 2º puerto de conmutación interno opcional para la conexión directa de la CPU de la aplicación
  • Aceleración por hardware opcional (DMA)
Tiempo de ciclo hasta 100 μs
Número de conexiones
  • Admite hasta 10 conexiones de E/S simultáneas
  • Admite hasta 10 sesiones de encapsulación simultáneas
  • Soporte para al menos 2 conexiones de mensajería explícita concurrentes (número mínimo garantizado) para cada sesión de encapsulación.
  • Admite hasta 6 conexiones de mensajería explícita adicionales que puede utilizar cualquier cliente.
Interfaz de programación de aplicaciones Interfaz de aplicación de dispositivo simple (SDAI)

Información del pedido

Volumen de suministro  
IP / Lógica
  • Subsistema adaptador EtherNet/IP completo
  • Núcleos IP suplementarios
  • Ejemplo de diseño FPGA
Software
  • Software de protocolo ya listo (ejecutable) para el subsistema adaptador EtherNet/IP
  • Biblioteca de API para el procesador de aplicación (incluido el código fuente)
  • Software de aplicación de muestra (incluido el código fuente)
Documentación Descargar: Guía de implementación del subsistema EtherNet/IP e información adicional
Números de referencia  
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Estaremos encantados de estudiar con usted sus necesidades específicas y las opciones de licencia adecuadas.
Productos y servicios adicionales  
SIA-YY-012501 Cursillo de integración para la implantación de EtherNet/IP
SIA-YY-012503 Soporte para la integración por correo electrónico o teléfono
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